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Bibliographische Daten des bestpassenden Buches
Autor: | |
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ISBN-Nummer: |
Detailangaben zum Buch - VLSI Design for Video Coding
EAN (ISBN-13): 9781441909596
ISBN (ISBN-10): 1441909591
Erscheinungsjahr: 2009
Herausgeber: Springer US
176 Seiten
Sprache: eng/Englisch
Buch in der Datenbank seit 2010-06-03T02:53:07+02:00 (Vienna)
Detailseite zuletzt geändert am 2023-09-08T05:15:55+02:00 (Vienna)
ISBN/EAN: 9781441909596
ISBN - alternative Schreibweisen:
1-4419-0959-1, 978-1-4419-0959-6
Alternative Schreibweisen und verwandte Suchbegriffe:
Autor des Buches: chao, hung, chen, huang, yang jian, long, youn yang, cheng
Titel des Buches: vlsi, standard, chi, chip, video, lin, design
Daten vom Verlag:
Autor/in: Youn-Long Steve Lin; Chao-Yang Kao; Hung-Chih Kuo; Jian-Wen Chen
Titel: VLSI Design for Video Coding - H.264/AVC Encoding from Standard Specification to Chip
Verlag: Springer; Springer US
176 Seiten
Erscheinungsjahr: 2009-12-29
New York; NY; US
Sprache: Englisch
96,29 € (DE)
99,00 € (AT)
118,00 CHF (CH)
Available
XI, 176 p.
EA; E107; eBook; Nonbooks, PBS / Technik/Elektronik, Elektrotechnik, Nachrichtentechnik; Schaltkreise und Komponenten (Bauteile); Verstehen; Architectural Design for Video; Cinoression; Filter; H.264/AVC; High Definition Video; Low Power Video; MPEG-4; Motion Compensator; Motion Estimator; Real-time video; VLSI Design for Video; Video Coding; integrated circuit; B; Electronic Circuits and Systems; Computer-Aided Engineering (CAD, CAE) and Design; Engineering; Computer-Aided Design (CAD); BB
to Video Coding and H.264/AVC.- Intra Prediction.- Integer Motion Estimation.- Fractional Motion Estimation.- Motion Compensation.- Transform Coding.- Deblocking Filter.- CABAC Encoder.- System Integration.Presents state-of-the-art VLSI architectural design and chip implementation for high definition H.264/AVC video encoding Employs massively parallel processing to deliver up to 33 million pixels, with efficient design that can be prototyped via FPGA Every subsystem is presented from standard specification, algorithmic description, design considerations, timing planning, block diagram to test-bench verification Verilog RTL codes and testbenches available for download
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